【摘 要】
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随着物联网（Io T）技术的迅猛发展,各种物联网设备层出不穷。物联网技术已经在工业4.0、智能城市、智能家居、互联汽车和电子健康等领域产生了许多里程碑式的应用。从应用场景出发,如何在保证性能的前提下获得功耗更低、面积更小的物联网设备是各大物联网厂商首要考虑的问题。支持Hyper Bus协议的Hyper RAM是这一需求的最新解决方案。Hyper RAM兼顾接口引脚数少、功耗低以及高性能等优势,日趋
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随着物联网（Io T）技术的迅猛发展,各种物联网设备层出不穷。物联网技术已经在工业4.0、智能城市、智能家居、互联汽车和电子健康等领域产生了许多里程碑式的应用。从应用场景出发,如何在保证性能的前提下获得功耗更低、面积更小的物联网设备是各大物联网厂商首要考虑的问题。支持Hyper Bus协议的Hyper RAM是这一需求的最新解决方案。Hyper RAM兼顾接口引脚数少、功耗低以及高性能等优势,日趋成为物联网设备的首选存储外设。为了实现对Hyper RAM的逻辑功能控制,本文设计了一款Hyper RAM控制器,通过将来自AHB（Advanced High-performance Bus）总线的信息处理后转换为Hyper Bus接口信息输送给Hyper RAM,从而实现对Hyper RAM的读写控制和功能配置。本文提出了Hyper RAM控制器的整体设计结构,其中两条AHB总线接口模块用于接收来自MCU（Micro Controller Unit）的总线信息,一条用于传输读写数据,另一条用于传输寄存器配置值,寄存器配置模块用于对控制器寄存器和Hyper RAM内部的功能寄存器进行配置和更新,仲裁模块用于响应数据总线或寄存器总线,延时控制模块用于处理中心采样和多比特数据校准。本文针对所设计控制器提出验证思路,制定验证方案,基于通用验证方法学UVM（Universal Verification Methodology）搭建验证平台进行功能仿真,针对各个验证功能点编写测试激励完成对该控制器的仿真验证。在多次迭代之后最终获得符合预期结果的覆盖率分析报告,其中功能覆盖率结果为100%,代码覆盖率为98.6%,所有打印日志显示通过,证明设计正确。
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