【摘 要】
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简要介绍了当前集成电路延迟调节的主流技术。针对工程应用,提出了一种分段式数控延迟线(DCDL)的设计方法,解决了延迟调节精度和调节范围之间的矛盾,具有面积小、线性度好和
【机 构】
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模拟集成电路重点实验室,中国电子科技集团公司第二十四研究所,
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简要介绍了当前集成电路延迟调节的主流技术。针对工程应用,提出了一种分段式数控延迟线(DCDL)的设计方法,解决了延迟调节精度和调节范围之间的矛盾,具有面积小、线性度好和调节范围大等优点。基于0.18μm 1P5M CMOS工艺,对电路进行流片。测试结果显示,设计的分段型数控延迟线的调节精度为12ps,动态范围为4ns。
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