一种并行乘法器的设计与实现

来源 :计算机应用研究 | 被引量 : 16次 | 上传用户：guilinzd

【摘要】

：

根据补码的特点对Booth2算法进行了改进 ,在得到部分积的基础上 ,采用平衡的 4 2压缩器构成的Wallace树对部分积求和 ,再用专门的加法器对Wallace产生的结果进行求和得到最终结果。用Verilog硬件语言进行功能描述 ,并用Design_analyzer对其进行综合 ,得出用这种改进Booth2算法实现的乘法器比传统的CSA阵列乘法器速度快、规模较大的结论

【作者】

：

王新刚樊晓桠李瑛齐斌

【机构】

：

西北工业大学

【出处】

：

计算机应用研究

【发表日期】

：

2004年07期

【关键词】

：

并行乘法器 Booth2 WALLACE树 Parallel Multiplier Booth2 Wallace Tree

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