【摘 要】
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对现有不同的8B／10B编解码方案进行了介绍和分析，同时研究8B／10B的编码特点和内在相关性，在此基础上提出一种可移植性8B／10B编解码方法，用VHDL语言进行设计，给出了仿真和综合结果。
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对现有不同的8B／10B编解码方案进行了介绍和分析，同时研究8B／10B的编码特点和内在相关性，在此基础上提出一种可移植性8B／10B编解码方法，用VHDL语言进行设计，给出了仿真和综合结果。将其嵌入到FPGA中可构成一个资源占用少、速度快、可靠性高、可移植的IP核，实现了具体的硬件电路，验证了设计方法的有效性和可行性。
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