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本文从抑制时序电路中的冗余状态、时钟信号冗余跳变产生的额外功耗出发,提出了一种低功耗十进制计数器的新设计.用PSPICE程序模拟证实了这种十进制计数器具有正确的逻辑功能,并且节省功耗明显.
基于冗余抑制技术的十进制计数器设计
【摘 要】
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本文从抑制时序电路中的冗余状态、时钟信号冗余跳变产生的额外功耗出发,提出了一种低功耗十进制计数器的新设计.用PSPICE程序模拟证实了这种十进制计数器具有正确的逻辑功能
【机 构】
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宁波大学,宁波大学,宁波大学
【出 处】
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科技通报
【发表日期】
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2005年2期
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