【摘 要】
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随着计算机处理技术和现代通信技术的迅猛发展,无论是民用领域还是军用领域,对于数据处理的速度和精度需求都越来越高,集成电路工艺发展的日趋成熟也使得研发高速高精度数据转换器成为可能。数模转换器是数字信号和模拟信号的关键接口之一,其速度与精度已经成为制约现代通信以及数据处理的瓶颈,因此研究高速高精度DAC具有十分重要的意义。本文中14位DAC基于TSMC 40nm LP CMOS工艺,采用分段电流舵架构
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随着计算机处理技术和现代通信技术的迅猛发展,无论是民用领域还是军用领域,对于数据处理的速度和精度需求都越来越高,集成电路工艺发展的日趋成熟也使得研发高速高精度数据转换器成为可能。数模转换器是数字信号和模拟信号的关键接口之一,其速度与精度已经成为制约现代通信以及数据处理的瓶颈,因此研究高速高精度DAC具有十分重要的意义。本文中14位DAC基于TSMC 40nm LP CMOS工艺,采用分段电流舵架构,全差分输出,双电源供电,模拟和数字电源分别为1.8V和1.1V,完成了包括带隙基准电压、电压转电流电路、共源共栅电流源阵列、低压宽摆幅偏置电路、差分开关阵列、分段译码电路、锁存器阵列、输入同步寄存器等电路的原理图设计和版图设计,并给出芯片测试方案。为了折中电路的面积、性能以及复杂度的影响,14位DAC采用5+4+5的三段译码结构,将二进制加权和温度计加权的优点相结合以达到较好的静态性能;带隙基准电压源采用适用于低电源电压的结构,实现了基准电压温度特性和输出摆幅可调节的功能;为了减小时钟馈通效应,保证电流源阵列始终处于导通状态,锁存器电路采用限幅结构,以降低开关控制信号的摆幅,并使其交叉点低于阈值电压;为了提高电流源的输出阻抗,改善电路的动态性能,采用共源共栅结构作为电流源阵列的基本单元,基于电流源的失配分析,确定了电流源的最小面积;在电流源阵列版图布局中,以共中心四象限对称法为基础,将高位电流源分裂布置到空间对称位置以减小系统误差。后仿结果表明,时钟频率为500MHz时,该DAC的DNL和INL为0.30LSB和0.38LSB,功耗为17.99mW,正弦输入信号频率为5.86MHz时,SFDR为94.66dB,输入频率为130.68MHz时,SFDR为78.81dB;在1GHz时钟频率时,该DAC的DNL和INL分别为0.47LSB和0.57LSB,输入频率为11.72MHz时,后仿SFDR为89.99dB。
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