超宽带通信系统跟踪环路设计及其VLSI实现研究

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在脉冲体制超宽带(IR-UWB,Impulse Radio Ultra Wide-band)无线通信系统中,由于超宽带无线信号极窄的脉冲周期,当使用Rake接收机进行解调时,极小的定时误差会使接收机收集到的能量减少很多,从而引起系统性能的极大衰减。为了解决这一难题,本文提出了一种数模混合同步采样的适用于脉冲体制超宽带无线通信系统的锁时跟踪环路来减少定时误差,提高系统性能。本文首先通过研究窄带通信系统中跟踪环路的设计,考虑脉冲体制超宽带无线通信系统跟踪环路设计的特殊性,采用最大似然估计的方法,得到跟踪环路中最重要环节—时间误差检测器的结构,基于该时间误差检测器完成整个跟踪环路的设计并通过分析该环路的S-Curve和定时误差方差得到了定性跟踪性能的数学分析和仿真。在密集多径信道下面的系统仿真实验结果表明,当采用选择性Rake(SRake)接收机时,该跟踪环路能有效跟踪半脉冲周期左右的时间抖动,使系统的误码率性能有近三个数量级的提高。在综合考虑环路性能与硬件实现复杂度的前提下,进行了该跟踪环路的硬件设计,搭建测试平台,并由FPGA仿真获得该跟踪环路能有效地跟踪时间误差信号,提高系统的误码率性能。
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