【摘 要】
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在当今朝着大规模、小体积、高速度方向发展的电子设计领域中。体积减小导致电路布局布线密度变大，同时伴随着信号频率的提高，使得串扰成为高速、高密度PCB设计中值得关注的问
【机 构】
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南京航空航天大学信息科学与技术学院,江苏南京 210016
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在当今朝着大规模、小体积、高速度方向发展的电子设计领域中。体积减小导致电路布局布线密度变大，同时伴随着信号频率的提高，使得串扰成为高速、高密度PCB设计中值得关注的问题。本文采用基于矩量法的电磁仿真软件(ADS)，分别研究了走线间距、走线重叠面积、并行长度等对串扰的影响，最后提出了减小抑制串扰的方法。
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