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摘要根据JK触发器的鉴相特性，论文提出了0°～360°数字相位检测电路的设计和测试方案。采用VerilogHDL完成了电路设计，在Altera公司的QuartusⅡ软件平台上完成了仿真，在FPGA上实现了硬件测试，为后续的工程应用研究提供了重要的参考。
高精度实时相位检测电路的FPGA设计
【摘 要】
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摘要根据JK触发器的鉴相特性，论文提出了0°～360°数字相位检测电路的设计和测试方案。采用VerilogHDL完成了电路设计，在Altera公司的QuartusⅡ软件平台上完成了仿真，在F
【机 构】
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湖北经济学院法商学院电子工程系
【出 处】
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计算机与数字工程
【发表日期】
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2013年10期
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