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基于FPGA实现Viterbi译码器IP-Core的技术研究
基于FPGA实现Viterbi译码器IP-Core的技术研究
来源 :黑龙江工程学院学报 | 被引量 : 0次 | 上传用户:windplume
【摘 要】
:
提出一种基于FPGA实现Viterbi译码器的结构,利用该结构实现的Viterbi译码器具有通用性.在设计中充分利用FPGA的特点,使Viterbi译码器的译码速度得到提高,并且译码延时比较小.
【作 者】
:
白红哲
王晶
高嵩
【机 构】
:
哈尔滨理工大学,黑龙江省通信公司网管中心,黑龙江省通信传输局
【出 处】
:
黑龙江工程学院学报
【发表日期】
:
2004年3期
【关键词】
:
VITERBI译码器
FPGA
VHDL
Viterbi Decoder FPGA VHDL
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提出一种基于FPGA实现Viterbi译码器的结构,利用该结构实现的Viterbi译码器具有通用性.在设计中充分利用FPGA的特点,使Viterbi译码器的译码速度得到提高,并且译码延时比较小.
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