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基于双边沿检测技术获得时钟信号的倍频窄脉冲,利用该脉冲对时钟信号的双边沿计数,进而实现了时钟信号的整数和半整数分频．采用VHDL硬件描述语言和原理图输入方式,在QuartusⅡ平台下实现分频器的综合和仿真,并用ACEX1K30芯片实现．实验表明该方法的有效性和可靠性．
一种新的可控分频器的FPGA实现
【摘 要】
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基于双边沿检测技术获得时钟信号的倍频窄脉冲,利用该脉冲对时钟信号的双边沿计数,进而实现了时钟信号的整数和半整数分频．采用VHDL硬件描述语言和原理图输入方式,在QuartusⅡ
【机 构】
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西南大学电子信息工程学院
【出 处】
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西南大学学报(自然科学版)
【发表日期】
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2007年01期
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