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根据监视跟踪定时器的工作原理,介绍了一种实用看门狗电路的VerilogHDL设计及CPLD实现方法,结构简单、功能完善,可与任何综合库、工艺库以及FPGA/CPLD芯片结合开发出用户需要的门级网表和芯片版图,易于移植.文中还介绍了针对复杂数字系统的FPGA/CPLD开发设计的流程.
监视跟踪定时器电路的CPLD实现
【摘 要】
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根据监视跟踪定时器的工作原理,介绍了一种实用看门狗电路的VerilogHDL设计及CPLD实现方法,结构简单、功能完善,可与任何综合库、工艺库以及FPGA/CPLD芯片结合开发出用户需要
【机 构】
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上海大学微电子研究中心
【出 处】
：
电子工程师
【发表日期】
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2003年12期
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