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介绍了FPGA内嵌的PCIExpress硬核端点模块和Wishbone片上总线规范。应用VHDL语言，编程实现了Wishbone总线的主从端口，以及TLP包的编码和解码功能。在FPGA上运行程序并使用Chipscope测试时序波形，验证了接口数据传输的稳定性和正确性。
基于Wishbone和端点IP的PCIE接口设计
【摘 要】
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介绍了FPGA内嵌的PCIExpress硬核端点模块和Wishbone片上总线规范。应用VHDL语言，编程实现了Wishbone总线的主从端口，以及TLP包的编码和解码功能。在FPGA上运行程序并使用Chips
【机 构】
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国防科学技术大学ATR国家重点实验室
【出 处】
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现代电子技术
【发表日期】
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2012年11期
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