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提出一种取样示波器主控单元的设计方法和硬件软件化的设计思路,用Verilog硬件描述语言进行设计.用EDA工具进行综合和仿真,在单片CPLD上实现了取样示波器主控单元电路.
取样示波器主控单元CPLD
【摘 要】
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提出一种取样示波器主控单元的设计方法和硬件软件化的设计思路,用Verilog硬件描述语言进行设计.用EDA工具进行综合和仿真,在单片CPLD上实现了取样示波器主控单元电路.
【机 构】
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北京航空航天大学
【出 处】
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电子测量技术
【发表日期】
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2003年5期
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