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提出了一种基于FPGA的时钟跟踪环路的设计方案，该方案简化了时钟跟踪环路的结构，降低了时钟调整电路的复杂度。实际电路测试结果表明，该方案能够使接收机时钟快速准确地跟踪发射机时钟的变化，且时钟抖动小、稳准度高、工作稳定可靠。
一种基于FPGA的时钟跟踪环路的设计与实现
【摘 要】
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提出了一种基于FPGA的时钟跟踪环路的设计方案，该方案简化了时钟跟踪环路的结构，降低了时钟调整电路的复杂度。实际电路测试结果表明，该方案能够使接收机时钟快速准确地跟踪发射
【机 构】
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西安电子科技大学综合业务网国家重点实验室
【出 处】
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电子技术应用
【发表日期】
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2006年1期
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