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浮点数加法运算是浮点运算中使用频率最高的运算。结合VHDL和FPGA可编程技术，完成具有5级流水线结构、符合IEEE754浮点数标准、可参数化为单／双精度的浮点数加法器IP核的VHDL设计。
浮点加法器IP核的VHDL设计
【摘 要】
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浮点数加法运算是浮点运算中使用频率最高的运算。结合VHDL和FPGA可编程技术，完成具有5级流水线结构、符合IEEE754浮点数标准、可参数化为单／双精度的浮点数加法器IP核的VHDL设
【机 构】
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广东工业大学信息工程学院,广州大学物理与电子工程学院
【出 处】
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山西电子技术
【发表日期】
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2006年4期
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