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介绍一种适于数字CMOS工艺实现的全差分运算放大器的设计.该放大器用于电源电压为3V,分辩率为10位,采样频率为40MHz的流水线结构AD的采样保持和级间增益电路中.该放大器的结构为折叠-级联结构,在0.35μmCMOS工艺中带宽为162MHz,开环增益为73dB,功耗为1.92mW.
一种用于低电源电压的全差分运算放大器
【摘 要】
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介绍一种适于数字CMOS工艺实现的全差分运算放大器的设计.该放大器用于电源电压为3V,分辩率为10位,采样频率为40MHz的流水线结构AD的采样保持和级间增益电路中.该放大器的结
【机 构】
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电子机械高等专科学校电气系
【出 处】
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电子与封装
【发表日期】
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2004年4期
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