0.13μm CMOS超宽带低噪声放大器的设计

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本文应用Cadence Virtuoso软件平台设计了一个电阻并联交流反馈式共源共栅超宽带低噪声放大器,并采用中芯国际0.13μmCMOS工艺实现了样片。测试结果给出,在供电电压为1.5V,功耗为22.5mW的情况下,芯片最大增益为13.6dB,最小噪声系数为3.6dB,带内噪声系数小于6dB,输入三阶互调截点(IIP3)为-3dBm。测试结果与仿真结果非常接近。
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