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本文主要研究了用FPGA芯片内部的EBRSRAM来实现异步FIFO设计方案,重点阐述了异步FIFO的标志信号——空/满状态的设计思路,并且用VHDL语言实现,最后进行了仿真验证。
高速异步FIFO的设计与实现
【摘 要】
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本文主要研究了用FPGA芯片内部的EBRSRAM来实现异步FIFO设计方案,重点阐述了异步FIFO的标志信号——空/满状态的设计思路,并且用VHDL语言实现,最后进行了仿真验证。
【机 构】
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洛阳理工学院,西安建筑科技大学
【出 处】
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微计算机信息
【发表日期】
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2009年20期
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