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针对普通延迟单元电路在PVT变化时延迟时间变化大的现象，设计了一个基于数字延迟锁相环结构，延迟时间不受PVT影响的可编程延迟时间电路。该电路的创新点主要有采用全数字电路设计，具有通道的可扩展性，其功耗低、锁定时间短。
双通道快速锁定延迟电路的设计
【摘 要】
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针对普通延迟单元电路在PVT变化时延迟时间变化大的现象，设计了一个基于数字延迟锁相环结构，延迟时间不受PVT影响的可编程延迟时间电路。该电路的创新点主要有采用全数字电路设
【机 构】
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华东电子工程研究所
【出 处】
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管理观察
【发表日期】
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2009年17期
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