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分析了两种常用硬件描述语言Verilog 和VHDL的语言特征,找出它们之间内在的对应关系,并阐述了由VHDL向Verilog语言翻译的实现方法.这对于硬件设计具有辅助作用.
硬件描述语言VHDL到Verilog的翻译
【摘 要】
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分析了两种常用硬件描述语言Verilog 和VHDL的语言特征,找出它们之间内在的对应关系,并阐述了由VHDL向Verilog语言翻译的实现方法.这对于硬件设计具有辅助作用.
【机 构】
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西北大学,软件工程研究所,陕西,西安,710069西安邮电学院,ASIC中心,陕西,西安,710061;
【出 处】
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西北大学学报（自然科学版）
【发表日期】
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2004年期
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