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提出了一种改进时序重排算法，使时序重排可以更有效地与其他组合优化算法结合起来，共同提高同步时序电路的速度.在各种不同的测试电路上得到的实验结果显示，这种算法在与其他组合优化方法的结合上，较以往的时序重排算法有很大的改进.
一种用于高速逻辑电路综合优化的新算法
【摘 要】
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提出了一种改进时序重排算法，使时序重排可以更有效地与其他组合优化算法结合起来，共同提高同步时序电路的速度.在各种不同的测试电路上得到的实验结果显示，这种算法在与其他组
【机 构】
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上海交通大学大规模集成电路研究所
【出 处】
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上海交通大学学报
【发表日期】
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2001年2期
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