【摘 要】
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本文首先建立通用数字IC的故障模型,引入故障等效和支配的概念,将IC最小完备测试集的算法复杂性从0(2~n)降低至0(n)。本文给出组合逻辑IC的布尔差分运算和时序逻辑IC的FSM形
【机 构】
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兰州铁道学院电信与自控研究所,兰州铁道学院副教授730070
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本文首先建立通用数字IC的故障模型,引入故障等效和支配的概念,将IC最小完备测试集的算法复杂性从0(2~n)降低至0(n)。本文给出组合逻辑IC的布尔差分运算和时序逻辑IC的FSM形式描述.最终建立了组合逻辑IC和时序逻辑IC的测试生成算法。 本文是PC-ICT通用数字IC测试系统及其软件包研究课题的理论进展之一。本研究成果已在铁路系统批量生产,并在铁路微电子设备故障检测和可靠性保障中获得了实际应用。
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