基于CPLD的多通道快速数据栈区设计

来源 :现代电子技术 | 被引量 : 0次 | 上传用户：hahaohan

【摘要】

：

利用在系统可编程逻辑器件ispLSI6192芯片构造4个双向并独立的128×9位FIFO高速数据存储栈区(FIFO),并利用芯片内部快速进位逻辑建立快速地址寄存器和地址自动加1计数器,

【作者】

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邵蓉

【机构】

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辽宁石油化工大学信息工程学院辽宁抚顺113001

【出处】

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现代电子技术

【发表日期】

：

2004年6期

【关键词】

：

多通道快速数据栈区在系统可编程逻辑器件 FIFO控制逻辑 isPLSI6192 Multiple high speed data memory in sys

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利用在系统可编程逻辑器件ispLSI6192芯片构造4个双向并独立的128×9位FIFO高速数据存储栈区(FIFO),并利用芯片内部快速进位逻辑建立快速地址寄存器和地址自动加1计数器,同时利用该芯片的门阵列建立FIFO控制逻辑,控制逻辑分别对4个FIFO栈区进行读写管理控制;即将系统的高速数据栈区及其控制逻辑功能做在同一个芯片上,从而提高计算机数据管理通信的速度、效率,以及提高系统的集成度和降低系统的故障率.

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