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介绍了RS（255,223）码级联卷积（4,3,3）码编译码器的实现,对于编码和译码端不同的结构特点,分别采用并行和串行结构实现。其中RS译码采用欧几里德算法,卷积译码采用维特比算法。同时给出了该编译码器的FPGA实现,按照自上而下的设计流程,在保证速度的同时最大限度地减少了资源占用。
基于级联码的信道编译码设计与FPGA实现
【摘 要】
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介绍了RS（255,223）码级联卷积（4,3,3）码编译码器的实现,对于编码和译码端不同的结构特点,分别采用并行和串行结构实现。其中RS译码采用欧几里德算法,卷积译码采用维特比算法。同
【机 构】
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上海交通大学电子工程系
【出 处】
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信息技术
【发表日期】
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2008年11期
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