【摘 要】
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本文提出了基于LUT的FPGA的时序分析方法和后仿真的设计方案,并予以实现。时序分析和后仿真是在布局布线基础之上进行的,是FPGA支持软件系统不可缺少的两个步骤。在时序分析
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本文提出了基于LUT的FPGA的时序分析方法和后仿真的设计方案,并予以实现。时序分析和后仿真是在布局布线基础之上进行的,是FPGA支持软件系统不可缺少的两个步骤。在时序分析阶段,从FPGA芯片结构和电路的布线信息中抽象出时序节点和时序边来构造时序图,根据时序图计算电路可达节点间的延时和关键路径,配合图形界面打印出电路各个输入输出之间的延时信息并高亮显示其路径。解决了布局布线后无法得到电路的详细延时值的问题,为布局布线后的仿真提供了必不可少的时序信息。在后仿真阶段,设计了一个Post-Simulator后仿真器。Post-Simulator根据输入信号值遍历时序图,查找芯片中LUT内存信息,从而得到电路输出的值,再结合时序分析得到的延时信息生成一个后仿真波形文件,通过波形分析器查看波形。后仿真进一步验证了电路的时序信息和逻辑功能。
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