AES混合加密算法的研究及其FPGA实现

来源 :华东师范大学 | 被引量 : 0次 | 上传用户:myyiao123
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随着近年来信息技术的不断发展,信息安全技术在其中的地位也随之越来越重要,而信息安全的核心是密码技术。在目前众多的加密算法中,AES加密算法以其安全、性能好、效率高、实用、灵活而得到广泛的应用。但使用AES进行保密通信时,通信双方需要采取相同的密码,因此其密钥的分发和管理非常复杂、代价高昂。本论文在综合了国内外近年来在密码学算法的研究以及相关技术发展的基础上,经过系统深入的研究,最终采用了AES加密数据,RSA加密密钥的混合加密算法。引入RSA加密密钥这一方法,在不对AES加密速度产生很大影响的情况下,有效解决了AES在密钥管理方面的不足。最终得到的算法用VerilogHDL编写代码,并下载到Xilinx公司的VirtexⅡ系列xc2v1000器件中,经验证功能正确,同时还进行了ASIC的前端设计。 本论文主要展开了以下几个方面的工作: 1.对AES和RSA加密算法进行了分析和比较,得出这两种加密算法之间具有互补性,它们的混合加密具有可行性。 2.根据AES和RSA加密算法各自特点——AES速度快,适合加密数据量大的信息;RSA密钥管理方便,适合于加密关键性信息,提出用AES加密数据、RSA加密密钥的混合加密算法。并编写Verilog HDL代码,选用Xilinx公司的XST软件进行综合,最后下载至xc2v1000器件中,经验证功能正确。 3.将得到的Verilog HDL源文件进行AISC的前端实现。采用台积电的0.25um CMOS工艺库,用Design Compiler进行综合,Primetime进行静态时序分析,Formality进行形式验证。最后得到优化后的门级网表。综合后运行速度达到25MHz,占用门数约为17万门。
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