基于ARM的H.264 & AVS联合解码器的ESL建模

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随着90nm技术的出现,上亿门规模电路的开发及系统的复杂度俱增,嵌入式软件开发任务与系统架构设计工作量的增加远大于硬件实现复杂度的增加,设计前期在系统级别进行软硬件划分、提早的进行软件开发成为一款SoC芯片成功的关键因素。目前的RTL级别的设计方法软硬件协同仿真在整个设计周期的中后期才开始进行,不利于尽早发现设计中的瓶颈与提前开始软件的开发。先进的视频解码SoC系统需要在设计前期在系统级别进行软硬件规划,同时迫切需要高效的性能分析和验证方法平台对算法从架构层次上优化性能。电子系统级设计方法学(Electronic System Level ,ESL)的出现将彻底解决上述问题。本文将先进的电子系统级设计方法学引入H.264&AVS视频解码SoC系统的设计中。通过ESL性能分析平台分析解码器系统的算法瓶颈,从而对整个系统的任务进行软硬件划分。在此基础上,采用周期精确的SystemC事务级建模对H.264&AVS帧内预测算法与IDCT变换进行建模,把解码加速模块的设计核心放在数据通路的设计上,并将其以并行的方式进行系统集成。最终建立起基于ESL的软件算法与硬件架构协同仿真验证的SoC协同验证平台,实践证明利用ESL进行系统设计不仅可以有效提高仿真验证速度,而且设计的视频解码硬件能有效改善系统的性能。
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