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本文介绍了一种固定信号格式的串并转换,利用Verilog HDL语言对一块可编程逻辑器件进行编程,实现单片机串行口输出的串行数据到8位并行数据的转换。
用Verilog HDL语言设计实现单片机串行口输出的串并转换
【摘 要】
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本文介绍了一种固定信号格式的串并转换,利用Verilog HDL语言对一块可编程逻辑器件进行编程,实现单片机串行口输出的串行数据到8位并行数据的转换。
【机 构】
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北方工业大学微电子实验中心,北京,100041
【出 处】
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第十二届全国青年通信学术会议
【发表日期】
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2007年期
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